職位描述
數字電路設計RTL設計Verilog網絡協(xié)議物聯(lián)網船舶/航空/航天/火車制造
技能要求：
1、負責交換機和端系統(tǒng)的FPGA設計方案及其相關文檔編寫；
2、負責FPGA的RTL代碼編寫、仿真、綜合和測試工作。
任職條件：
1. 本科以上學歷，計算機、通信、電子等相關專業(yè)畢業(yè)；
2. 三年以上FPGA邏輯設計經驗；
3. 具有良好的溝通協(xié)調能力和團隊合作精神；
4. 具備獨立完成FPGA邏輯代碼編寫、仿真和調試能力；
5 精通Verilog HDL，具有良好的編碼風格；
6 熟練使用modelsim仿真工具；
7. 熟悉Xilinx公司常用的FPGA器件，熟練掌握Vivado開發(fā)工具以及邏輯設計流程；
8. 熟悉Xilinx公司的芯片的GTX、PCIE、DMA控制器以及以太網MAC常用IP庫；
9. 熟悉UDP/IP,ARP，IEEE1588等網絡協(xié)議.
10. 具有交換機、端系統(tǒng)邏輯設計相關經驗者優(yōu)先。
1、負責交換機和端系統(tǒng)的FPGA設計方案及其相關文檔編寫；
2、負責FPGA的RTL代碼編寫、仿真、綜合和測試工作。
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1. 本科以上學歷，計算機、通信、電子等相關專業(yè)畢業(yè)；
2. 三年以上FPGA邏輯設計經驗；
3. 具有良好的溝通協(xié)調能力和團隊合作精神；
4. 具備獨立完成FPGA邏輯代碼編寫、仿真和調試能力；
5 精通Verilog HDL，具有良好的編碼風格；
6 熟練使用modelsim仿真工具；
7. 熟悉Xilinx公司常用的FPGA器件，熟練掌握Vivado開發(fā)工具以及邏輯設計流程；
8. 熟悉Xilinx公司的芯片的GTX、PCIE、DMA控制器以及以太網MAC常用IP庫；
9. 熟悉UDP/IP,ARP，IEEE1588等網絡協(xié)議.
10. 具有交換機、端系統(tǒng)邏輯設計相關經驗者優(yōu)先。
職位福利：五險一金、年底雙薪、績效獎金、加班補助、定期體檢、帶薪年假、周末雙休、餐補
工作地點
西安高新區(qū)錦業(yè)路69號創(chuàng)業(yè)研發(fā)園C區(qū)8號
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職位發(fā)布者
劉寶羽/HR
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西安云維智聯(lián)科技有限公司云維智聯(lián)科技是一家專業(yè)從事智能化控制系統(tǒng)研究的高科技公司，公司位于西安高新區(qū)核心地段，注冊資本5357.1428萬。公司瞄準高端裝備信息化和智能化應用需求，以物聯(lián)網、物理信息系統(tǒng)CPS等先進IT技術為背景，研究高可靠、高安全、網絡化的智能控制技術和TSN（時間敏感網絡）技術，研制嵌入計算機、網絡設備、智能控制器，基于TSN網絡構建分布式強實時智能化控制系統(tǒng)，實現工業(yè)控制、測量與信息網的互聯(lián)，打破現有封閉工業(yè)控制技術體系，實現控制與信息無縫融合，從根本上改變現有控制系統(tǒng)的設計和維護過程。為我國的航天、航空、高鐵、電力等領域的高端裝備的控制系統(tǒng)轉型升級和自主化設計提供解決方案、產品支持和集成服務。公司業(yè)務主要涵蓋TSN網絡產品研制、標準計算機模塊研制、智能控制平臺研制、系統(tǒng)集成與服務四大方面。團隊主要成員來源于高校、科研院所和知名通信公司，具備工業(yè)網絡和智能控制系統(tǒng)的自主設計工程經驗和驗證能力。公司已與知名高校建立聯(lián)合實驗室加大產品理論研究和標準制定。
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