職位描述
VHDLVerilog
職責(zé)：
在Xilinx的K7、Zynq平臺下，完成邏輯開發(fā)、驗證、仿真工作。主要實現(xiàn)串口、AD、GPIO等常用外設(shè)的邏輯功能，實現(xiàn)視頻的輸入、輸出、縮放及拼接功能。
要求：
1、熟悉Verilog或者VHDL語言。
2、熟悉常用外設(shè)的邏輯開發(fā)。
3、獨立完成過FPGA開發(fā)項目。
職位福利：五險一金、周末雙休、績效獎金
在Xilinx的K7、Zynq平臺下，完成邏輯開發(fā)、驗證、仿真工作。主要實現(xiàn)串口、AD、GPIO等常用外設(shè)的邏輯功能，實現(xiàn)視頻的輸入、輸出、縮放及拼接功能。
要求：
1、熟悉Verilog或者VHDL語言。
2、熟悉常用外設(shè)的邏輯開發(fā)。
3、獨立完成過FPGA開發(fā)項目。
職位福利：五險一金、周末雙休、績效獎金
工作地點
西安市-雁塔區(qū)-瞪羚路26號西安理工大學(xué)科技園C座2層
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