職位描述
DFT設計PythonSYNOPSYSCadence架構設計驗證
1.負責芯片模塊或頂層（Top Level）的綜合（Synthesis）工作，將RTL代碼轉換為門級網表（Netlist）。關鍵任務是根據設計需求，編寫和驗證精確的時序約束文件（SDC），并負責其檢查與完善，以確保時序簽核（Timing Signoff）的安全性與準確
2.主導綜合后的靜態時序分析（STA），識別并修復時序違例。同時，負責低功耗設計實現，包括功耗意圖文件（UPF）的生成、低功耗一致性檢查（MVRC）以及功耗分析，并與前后端工程師協作，對芯片的功耗（Power）、性能（Performance）、面積（Area）即PPA進行持續優化
3.負責形式驗證（Formality）以確保RTL與網表的功能一致性。驗收前端設計的RTL代碼質量，完成跨時鐘域檢查（CDC）和復位域檢查（RDC）。編寫綜合相關的設計文檔，并與前端設計、驗證及后端物理實現團隊緊密協作，推動設計問題的解決
2.主導綜合后的靜態時序分析（STA），識別并修復時序違例。同時，負責低功耗設計實現，包括功耗意圖文件（UPF）的生成、低功耗一致性檢查（MVRC）以及功耗分析，并與前后端工程師協作，對芯片的功耗（Power）、性能（Performance）、面積（Area）即PPA進行持續優化
3.負責形式驗證（Formality）以確保RTL與網表的功能一致性。驗收前端設計的RTL代碼質量，完成跨時鐘域檢查（CDC）和復位域檢查（RDC）。編寫綜合相關的設計文檔，并與前端設計、驗證及后端物理實現團隊緊密協作，推動設計問題的解決
1.本科及以上學歷，微電子、集成電路、電子工程、計算機、自動化等相關專業
2.5年及以上經驗，熟悉數字芯片綜合流程，能熟練使用主流EDA工具完成模塊級綜合任務
，能獨立負責復雜模塊或中小規模芯片的完整綜合任務，有成功流片經驗
3.掌握數字電路基礎知識，熟悉代碼規范、典型電路（如FIFO、狀態機）。了解綜合、形式驗證和靜態時序分析的基本原理，對低功耗設計方法（UPF）、PPA深度優化有更深入理解，能預見并系統性解決復雜技術問題
4.熟練使用Synopsys或Cadence的數字后端工具鏈，如 Design Compiler (DC)/Genus（綜合）、PrimeTime (PT)（時序分析）、Formality（形式驗證），能進行綜合環境搭建和腳本優化，并對工具原理有更深理解。
5.能夠使用 Tcl、Perl、Shell或Python? 等至少一種腳本語言進行自動化處理。具備良好的分析解決問題能力、團隊協作和溝通能力。具備較強的腳本開發能力以優化設計流程，在項目中有較強的主動性和技術推動力
2.5年及以上經驗，熟悉數字芯片綜合流程，能熟練使用主流EDA工具完成模塊級綜合任務
，能獨立負責復雜模塊或中小規模芯片的完整綜合任務，有成功流片經驗
3.掌握數字電路基礎知識，熟悉代碼規范、典型電路（如FIFO、狀態機）。了解綜合、形式驗證和靜態時序分析的基本原理，對低功耗設計方法（UPF）、PPA深度優化有更深入理解，能預見并系統性解決復雜技術問題
4.熟練使用Synopsys或Cadence的數字后端工具鏈，如 Design Compiler (DC)/Genus（綜合）、PrimeTime (PT)（時序分析）、Formality（形式驗證），能進行綜合環境搭建和腳本優化，并對工具原理有更深理解。
5.能夠使用 Tcl、Perl、Shell或Python? 等至少一種腳本語言進行自動化處理。具備良好的分析解決問題能力、團隊協作和溝通能力。具備較強的腳本開發能力以優化設計流程，在項目中有較強的主動性和技術推動力
工作地點
深圳龍崗區中科谷南區-C棟3樓
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職位發布者
韓玉清/人事經理
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武漢啟云方科技有限公司武漢啟云方科技有限公司（Wuhan Qiyunfang Technology Co., LTD.）聚焦于工業軟件、IT和安全等產品的研發、銷售、實施和服務，依托自主可控的核心技術，致力于為業界提供先進的工業軟件以及專業化的IT應用集成服務。公司核心團隊均具備20多年工業軟件研發或大型IT項目建設運維經驗，并堅持以自主可控為底、整合眾家之長的方針，持續為行業提供領先的產品和解決方案，目前產品已廣泛應用于智能制造行業的制造、設計、設備和材料等企業。公司總部位于武漢，在深圳設有全資子公司。我們的愿景：開啟夢想，成就偉業我們的使命：致力于成為業界一流的工業軟件及IT專業化服務公司，實現工業軟件國產化我們的價值觀：以客戶為中心，以奮斗者為本，長期堅持艱苦奮斗，堅持自我批判
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