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    更新于 8月28日

    FPGA邏輯開發(fā)工程師

    1.2-2.3萬
    • 無錫新吳區(qū)
    • 3-5年
    • 本科
    • 全職
    • 招1人

    職位描述

    Verilog HDLC++計算機硬件計算機軟件通信/網絡設備
    1、崗位職責:
    (1)負責FPGA邏輯設計、仿真、綜合、布局布線等開發(fā)工作。
    (2)根據項目需求,進行FPGA器件選型和配置。
    (3)編寫和維護相關技術文檔。
    (4)配合軟件工程師完成系統集成和測試工作。
    (5)參與產品優(yōu)化和改進,提高系統性能和穩(wěn)定性。
    2、崗位要求:
    (1)電子、通信、計算機等相關專業(yè)本科及以上學歷,3-5年以上的相關工作經驗,熟悉數字電路設計和FPGA開發(fā)流程。
    (2)精通Verilog或VHDL編程語言,熟練掌握C++語言,有實際FPGA代碼編寫和調試經驗,參與過項目研發(fā)全流程,具備大規(guī)模邏輯開發(fā)經驗。
    (3)熟悉Xilinx、Intel、Altera等主流FPGA器件及開發(fā)工具。
    (4)具備較強的邏輯分析能力和問題解決能力,善于溝通協作。
    (5)有高速接口(如PCIe、HDMI、USB等)開發(fā)經驗者優(yōu)先。
    (6)具備良好的團隊合作意識和精神,能夠有效配合并協同團隊解決項目開發(fā)與調試過程中遇到的問題。
    (7)英語四級以上,能熟練閱讀和理解英文資料、讀寫能力熟練。
    3、技能要求:
    (1)熟練使用EDA工具進行邏輯綜合、布局布線等操作。
    (2)熟悉硬件調試和測試方法,能夠進行硬件調試和故障排查。
    (3)有音頻、視頻處理或高速通信領域相關經驗者優(yōu)先。
    4、知識要求:
    (1)了解FPGA工作原理及開發(fā)流程。
    (2)熟悉數據傳輸和處理算法。
    (3)對硬件設計的安全性、可靠性和穩(wěn)定性有深入的理解。

    工作地點

    無錫新吳區(qū)江蘇阿瑞斯智能設備有限公司601室

    職位發(fā)布者

    杜雙雙/人事經理

    三日內活躍
    立即溝通
    公司Logo江蘇阿瑞斯智能設備有限公司
    江蘇阿瑞斯智能設備有限公司是國內領先的CIS掃描相機與嵌入式視覺系統解決方案供應商,公司擁有三大業(yè)務板塊:商用型影像傳感器系統,工業(yè)類視覺檢測系統,金融票據檢測系統。以圖像處理技術為核心,致力于為客戶提供高質量視覺檢測產品與服務!阿瑞斯公司匯聚了由博士、碩士等高技術人才組成精英研發(fā)團隊,通過跟中科院等科研院校的緊密合作,擁有深厚的技術積累,現已自主研發(fā)了三大系列產品,并擁有多項發(fā)明專利,實用新型專利以及軟件著作權等知識產權。未來,阿瑞斯秉承“與客戶共享成功、攜員工共同成長、為股東創(chuàng)造價值、創(chuàng)社會共同進步”的企業(yè)宗旨,為客戶推出更加智能化的產品!
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