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    更新于 12月26日

    fpga工程師

    1-2萬·14薪
    • 長春二道區(qū)
    • 3-5年
    • 碩士
    • 全職
    • 招5人

    職位描述

    Verilog HDLSystem Verilog
    崗位職責(zé)
    1.負(fù)責(zé)產(chǎn)品FPGA的架構(gòu)設(shè)計(jì)、代碼編寫、仿真等工作。
    2.協(xié)同其他專業(yè)工程師完成系統(tǒng)設(shè)計(jì)、系統(tǒng)聯(lián)調(diào)、可靠性試驗(yàn)、轉(zhuǎn)產(chǎn)等工作。
    3.參與公司新產(chǎn)品的方案設(shè)計(jì)、FPGA選型和技術(shù)評(píng)估。參與FPGA技術(shù)平臺(tái)建設(shè)工作。
    4.負(fù)責(zé)項(xiàng)目中FPGA設(shè)計(jì)相關(guān)文檔編寫及維護(hù);
    任職要求
    1.碩士及以上學(xué)歷,電子、通信相關(guān)專業(yè),具有良好的專業(yè)基礎(chǔ)知識(shí)。
    2.2~5年工作經(jīng)驗(yàn),具有良好的設(shè)計(jì)規(guī)范。
    3.精通FPGA芯片架構(gòu)和資源,熟悉FPGA的硬件架構(gòu)、典型外設(shè)。
    4.精通Verilog HDL、或System Verilog語言,精通FPGA開發(fā)工具及仿真調(diào)試工具。
    5.熟悉圖像傳感器、高速圖像傳輸接口,有相關(guān)工作經(jīng)驗(yàn)。
    6.工作態(tài)度嚴(yán)謹(jǐn),有較好的溝通和表達(dá)能力,有較強(qiáng)的邏輯思維,有較好的文檔能力。

    獎(jiǎng)金績效

    帶薪年假 餐補(bǔ)20/天,采暖補(bǔ)貼,節(jié)假日福利,生日禮金

    工作地點(diǎn)

    二道區(qū)長春光電信息產(chǎn)業(yè)園

    職位發(fā)布者

    顧經(jīng)理/招聘經(jīng)理

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    公司Logo大連恒馨科技有限公司
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